1. 교육 대상 및 기간, 장소
- 대상: 반도체에 관심있는 산업체 재직자, 대학생, 대학원생, 졸업생, 취업준비생
- 기간: 2022년 8월 8일(월) ~ 13일(토)
- 시간: 월~금요일 18:30~21:30, 토요일 13:00~18:00(총 20시간)
- 장소: 부산대학교 제6공학관 8608 실습실
2. 교육 인원 및 수강료
- 인원: 20명 이내
- 수강료: 학생, 취업준비생 250,000원 / 산업체 재직자 500,000원
3. 신청
- www.openhardware.co.kr 홈페이지에서 신청
- 신청 마감: 2022년 7월 31일까지 선착순 마감
4. 평가 및 수료
- 출석 및 퀴즈, 출석 80% 이상을 확보하여야 수료로 인정하여 수료증을 수여함
5. 문의
- 나인플러스아이티 부산지사 051-758-4841
6. 교육 내용
- 소프트웨어: Virtuos Schematic Editor, Layout Editor, Spectre, ADE, Physical Verification System, G-PDK
* 교육 내용과 일정은 일부 변경될 수 있습니다. |
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| *반도체 소자
- 반도체 최신 동향
- MOSFET 기본 동작 원리 및 특성
- CMOS 논리회로
*반도체 공정
- CMOS 8대 공정
*GPDK 180 Design Rule의 이해와 적용 |
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| *Cadence에서 자주 사용하는 UNIX Command
- UNIX 기본 명령어 실습
- 파일 사용 권한 관리 및 검색 명령 실습
- 프로세스 관리나 파일 백업 압축 명령 실습
*Cadence Schematic Editor 환경 설정 및 사용 방법 |
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| *Cadence Spectre Simulator 환경설정 및 사용 방법
- GPDK 180을 적용한 CMOS Inverter, CMOS Inverter를 응용한 Ring Oscillator, 디지털 논리 게이트(NAND, NOR 등) 및 디지털 논리 회로(FlipFlop, MUX 등) 설계
*새로운 프로젝트 생성 및 계층도면의 이해
*Inverter 회로 설계 작성, Simulation option의 설정, Transient 해석/Bias Point 해석, DC해석/AC해석, 전압원 및 전류원 사용법, Probe window 사용법 |
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| *Cadnece Spectre Simulator 환경설정 및 사용방법
- GPDK 180을 적용한 CMOS Inverter, 디지털 논리 게이트(NAND, NOR 등), 디지털 논리회로(FlipFlop, MUX 등) 및 아날로그 회로(차동증폭기) 설계
- 설계한 회로의 Simulation을 통한 결과 검증 |
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| *Virtuoso Layout Editor 설정 및 실습 1
- CMOS Inverter Layout & DRC/LVS 검증
*Virtuoso Layout Editor 설정 및 실습 2
- 디지털 논리게이트 및 디지털 논리회로 layout 실습 및 DRC/LVS 검증 |
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| *Virtuoso Layout Editor 설정 및 실습 2
- 디지털 논리게이트 및 디지털 논리회로 layout 실습 및 DRC/LVS 검증
*Virtuoso Layout Editor 설정 및 실습 3
- Analog Circuit(차동 증폭기) Layout & DRC/LVS 검증 |
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